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path: root/KiCAD/rev02_16.sch-bak
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EESchema Schematic File Version 4
EELAYER 26 0
EELAYER END
$Descr B 17000 11000
encoding utf-8
Sheet 18 27
Title "rev02_16"
Date "15 10 2016"
Rev ""
Comp ""
Comment1 ""
Comment2 ""
Comment3 ""
Comment4 ""
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*) Middle Right Bank
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*) Upper Left Bank
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*) Completely unused banks\nstill must be powered
Text Notes 5900 4700 0    60   ~ 12
*) Completely unused banks\nstill must be powered
Text Notes 8600 10230 0    84   ~ 12
FPGA unused banks
$Comp
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F 3 "" H 2300 4300 70  0000 C CNN
	1    2300 4300
	1    0    0    -1  
$EndComp
$Comp
L Cryptech_Alpha:VCCO_3V3 VCCO_3V3_32
U 1 1 58023F32
P 5800 4200
F 0 "VCCO_3V3_32" H 5800 4200 20  0000 C CNN
F 1 "+VCCO_3V3" H 5800 4130 30  0000 C CNN
F 2 "" H 5800 4200 70  0000 C CNN
F 3 "" H 5800 4200 70  0000 C CNN
	1    5800 4200
	1    0    0    -1  
$EndComp
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
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Wire Wire Line
	5800 4800 5600 4800
$Comp
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U 1 1 58023F31
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F 2 "Cryptech_Alpha_Footprints:BGA484C100P22X22_2300X2300X254" H 1490 4190 60  0001 C CNN
$EndComp
$Comp
L Cryptech_Alpha:XC7A200TFBG484_7 U13_8
U 1 1 58023F30
P 5400 7100
F 0 "U13_8" H 4990 4090 60  0000 L BNN
	1    5400 7100
	1    0    0    -1
F 2 "Cryptech_Alpha_Footprints:BGA484C100P22X22_2300X2300X254" H 4990 4090 60  0001 C CNN
$EndComp
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NoConn ~ 2100 7100
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$EndSCHEMATC